全加器 全加器-应用举例,全加器-结构化描述方式

全加器英语名称为full-adder,是用门电路实现两个二进制数相加并求出和的组合线路,称为一位全加器。一位全加器可以处理低位进位,并输出本位加法进位。多个一位全加器进行级联可以得到多位全加器。常用二进制四位全加器74LS283。一个全加器由两个异或门、三个与门、一个或门构成。S1、T1、T2、T3则是门与门之间的连线。代码显示了用纯结构的建模方式,其中xor 、and、or 是Verilog HDL 内置的门器件。

全加器 全加器-应用举例,全加器-结构化描述方式

一位全加器_全加器 -应用举例

真值表

一位全加器的真值表如下图,其中Ai为被加数,Bi为加数,相邻低位来的进位数为Ci-1,输出本位和为Si。向相邻高位进位数为Ci

输入输出Ci-1AiBiSiCi0000000110010100110110010101011100111111

描述

一位全加器的表达式如下:

S=A

  

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