爱华网由于随机元件放置所产生的两个问题，一是失去了均匀的基于栅格的测试节点的可访问性，二是失去了在所有层面上逻辑的、可预测的路由通道（可能使板层数增加）。除此之外在IEC出版物IEC97中确认的已接受的国际栅格对于新的设计应该为0.5mm，进一步分割为0.05mm。对这个问题的一个解决方法是，用所有的用于测试、路由和翻修点的、以0.05mm中心（或更大，基于设计）连接到通路孔的元件焊盘建立CAD数据库。然后，当在CAD系统上作元件的放置时，简单地放置元件以使得在焊盘之间有最少0.5mm的间隔，然后将正在放置的元件的通路孔跳出到下一个1.0mm的栅格点。
元件贴装与元件间隔
元件贴装
类型相似的元件应该以相同的方向排列在板上，使得元件的贴装、检查和焊接更容易。还有，相似的元件类型应该尽可能接地在一起，使网表或连通性和电路性能要求最终推动贴装。例如，在内存板上，所有的内存芯片都贴放在一个清晰界定的矩阵内，所有元件的第一脚在同一个方向。这是在逻辑设计上实施的一个很好的设计方法，在逻辑设计中有许多在每个封装上有不同逻辑功能的相似元件类型。在另一方面，模拟设计经常要求大量的各种元件类型，使得将类似的元件集中在一起颇为困难。不管是否设计为内存的、一般逻辑的、或者模拟的，都推荐所有元件方向为第一脚方向相同。
元件间隔 元件考虑现在已经讨论过的焊盘结构设计的信息对于表面贴装装配的可靠性是重要的。可是设计者不应该忽视SMT装配的可制造性、可测试性和可修理性。最小的封装元件之间的间隔要求满足所有这些制造要求。最大的封装元件之间的间隔是没有限制的；越大越好。有些设计要求，表面贴装元件尽可能地靠近。基于经验，所显示的例子都满足可制造性的要求。 在相邻元件之间的焊盘对焊盘的间隔应该是1.25mm[0.050"]的沿印制板所有边缘空隔，如果板是脱离连接器测试的；或者最少2.5mm[0.100"]，如果测试使用真空密封。这里规定的要求是推荐的最小值，除了导体几何公差。 注意事项 使用这个通用库形状允许在设计过程中两种结构中流之间的转换容易，不需要改变或编辑元件库。无任在哪一种情况，都保持了100%的测试点访问。如果要求较宽的导线，通路孔焊盘尺寸要相应地减小，以允许在导线和焊盘之间有足够的空隙。 使用裸铜上的阻焊涂层（SMOBC, Solder Mask Over Bare Copper）或者已经选择性地去掉电镀层的铜。阻焊与裸铜提供焊锡迁移的一个有效障碍。这可能提供足够的保护，甚至如果选项A和B被忽视。
